| 學分數 |
3
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修課時數 |
3
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開課班級 |
日間部四年制3年級 A班
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| 本課程與系所培養學生核心能力關聯度 | 高度關聯 | 中高關聯 | 中度關聯 | 中低關聯 | 低度關聯 |
| 運用數學、科學及資通訊知識的能力。 |
✔
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| 設計與執行實驗及分析數據的能力。 |
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✔
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| 執行資通訊工程實務所需技術與使用工具的能力。 |
✔
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| 設計資通訊應用系統及開發軟硬體的能力。 |
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✔
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| 計畫管理、有效溝通及團隊合作的能力。 |
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✔
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| 發掘、分析及解決問題的能力。 |
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✔
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| 持續關切時事議題、瞭解科技發展對社會影響及自我學習的習慣與能力。 |
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✔
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| 認知專業倫理與社會責任的重要性。 |
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✔
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| 本課程培養學生下列知識： |
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本課程主要內容為各種不同電路層次之低功率設計技術介紹，探討電路設計過程中，可能面臨到的耗電問題及解決方式。並透過實際的晶片佈局與模擬訓練學生具有低功率超大型積體電路設計的能力。
1.瞭解CMOS電路功耗原理2.瞭解各階層降低功率的方式3.學習降低動態功率技術4.學習降低靜態功率技術5.能進行IC晶片設計佈局與相關軟體操作This course gives an overview of low power VLSI circuit design at each circuit levels and discusses reduce power consumption circuit techniques, including power consumption of CMOS circuit, low power circuit techniques at each level, reduce dynamic power technique, reduce static power technique, chip layout and simulation to train students with the ability of the IC chip design.
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| 每週授課主題 |
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第01週：課程說明與介紹 第02週：超大型積體電路發展與產業現況 第03週：CMOS電路原理第04週：CMOS功率消耗介紹第05週：CMOS功率消耗介紹第06週：Hpices模擬軟體 - CMOS電路量測 第07週：Hpices模擬軟體 - CMOS電路量測 第08週：期中報告/小考第09週：期中考 第10週：降低動態功率消耗技術第11週：降低動態功率消耗技術第12週：降低靜態功率消耗技術第13週：降低靜態功率消耗技術第14週：降低漏電功率消耗技術第15週：降低漏電功率消耗技術第16週：電路設計範例第17週：期末報告 第18週：期末考
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| 成績及評量方式 |
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期中考：20%期末考：30%平時作業,小考,口頭報告及出席：50%
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| 證照、國家考試及競賽關係 |
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本課程無證照、國家考試及競賽資料。
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| 主要教材 |
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1. 書名："Digital Integrated Circuits," 2nd Edition. 作者：Jan M. Rabaey, A. Chandrakasan and B. Nikloic 出版社：台北圖書代理 (教科書)
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| 教師資料 |
教師網頁：http://www.cyut.edu.tw/~jflin/
E-Mail： jflin@cyut.edu.tw
Office Hour：
星期三,第3~4節,地點:E-736;
星期四,第3~4節,地點:E-736;
分機:4811
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